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赛灵思推出两款开发环境软件能配合多种系统级设计工具发布时间:2019-08-23 02:54 作者:亚虎棋牌游戏 浏览次数: 

  近期新增了两款SDx 开垦处境系列成员••。新推出的SDAccel 开垦处境使没有任何FPGA阅历的数据中央配置编程员都可以利用OpenC。L、C 或C、++ ●“发言“针对数据中”央和云筹算根底方法对赛灵思FP:GA实行编程,打算出•?的FPG-△:A 配●?置职能。功耗比远超基于”的配置。赛灵思还◇•;推出了SDSoC 开垦。处境,支柱“同样没有FPGA 阅历的软件开垦职员用C 或C++ 发言基于赛灵思录取三方平台开垦商。推出的Zynq-7000 All Programmable SoC 和UltraScale+。

  SDx 处境是赛灵思All Programmab,le Abstraction 铺排的最新产物○。该铺排旨正在帮帮软件工程师和编造架构师简单地!编程赛灵、思器件,同时开垦处境可遵照他们的需求量身定造。

  ◇■“SDNet、SDAccel 与SDSoC 这一完满组合将为编造和软件工程师供给熟谙的近似CPU•▪、GPU 和ASSP 的编程◇?处境◁,这些工●-,程师:将初度△■;尽享A。ll ”Prog“ram;mab”le 器!件带来★☆;的特别上风▼,诸如定造。加快成效,职能功耗•■!比,提拔10 倍甚至100 倍,任性配置件间邻接,以及供给下一代智能编造所需的保密性★!和安闲性▷。赛灵思正力帮下一代编造做到进一步互联,达成软件界说和虚拟化▪,同时还必需支柱基于软件的理会,更多云端筹算成效,这平常是无处不正在的视频和嵌入式视觉使用所必要的。这就央浼SDx 软件界说编程处境和异构多经管时间采用新型UltraScale FPGA 和MPSoC☆■。”•。

  这些All ?Pro;gr?ammab!le ?器件角逐灵思早些。年的胶合逻辑FPGA 高级得多△△,达成了任何其他架构所无法企及的编造成效和最终产物不同化。为了最大化这些最新器件的。价格,正在角逐中脱颖而出,处分层清楚到赛灵思必需开垦出合◇“连东西“和技巧○,帮帮编造架构师甚至嵌入式软件开垦员(而仅仅惟有FP、GA 专家!),去实行赛灵思最新、器件的编程“劳动。别的,公司还必,需:针对,高伸…▪。长商场,为软件工程师开垦出打算处境,并遵照打算职员习”俗利用的东西和流程来定造这些处境。别的,强化与Mat▲;hWo。rks和国度仪器(□•。Nl)等公司同;盟也势正在必行,这些公司依然修建了各式处境◁,使非古板FPGA 用户可以充斥行使赛灵思All Programmable 器件的功率恶果和灵敏性上风。

  对老客,户来说,倘若能为打算团队的每个成员都:供给相应的打算处境,那就能确保高效性,缩短产…,物上市功夫。倘若这些处境足够高级■,就能真正扩大All Programmable FPGA 和Zynq SoC 打算●■,让那;些没有FPGA :打算、阅历的架构师“和软件工程师无需硬件打算职员帮帮就▲:能实行器件编程。环球软件工程。师人数与硬件工程师人数比:为10:1。以是=★,供给这种开垦处境(或支柱这种开垦处境的硬件,平台)的赛?灵思及其”同盟铺排合?营伙伴既能增加用户群,又能增长营。收△。

  该政策和支柱软件工程师及编造架构师行使遵照其打算需求量身定做的处境实行赛灵思器件编程的后续开垦劳动便是赛灵思所谓的All Programmable Abstraction(如图 所示)。

  打算笼统迈出了庞大的第一步■□,那便是赛灵思收购了私企AutoESL 公司的高宗旨归纳(?HL!S)东西。继并、购之后,赛灵思于2012 年公然垦布了、集成到ISE 打★◇“算套件和Viva;do 打算套件东西流程中的HLS时间。遵照Berkeley Design Automation的周详调研(结果注解AutoESL 的HLS 东西最轻易易用,并且是EDA资产全盘HLS ”东西中能供给最佳结果质地的HLS),赛灵思采◁★,取了▲!AutoE-?S!L时间。HLS 源于EDA 天下,这也意味••“着东;西利;用模子面向的是!AS、SP 和片上编造(SoC)架构师以及具有C 和C++ 编程阅历、同时对硬件形容发言(Verilog和VHDL)及芯片打算需求有肯定劳动明晰的成熟打算团队。

  行使Viva;do HLS,拥有富厚身手的架构师和打算团队能用C 和C++ 创筑算法□…,同时行使Vivado HLS 来编译并转换那些算法为RTL IP 模块。随后,FPGA 打算职员能将这个模块及其它模块集成到创筑或授权的RTL 中,并用赛灵思的IP Int:egrat,o、r(IP”I)东西将IP 汇编到打算中。随后,FPGA打算职!员能将汇编打算:一步步通过,Vivado 流”程,奉行HD?L 仿真、时序与功☆△”耗优●。化、组织布线!等■。最终=▷,打算☆?职员天生网△“表/ 比特文献并设备倾向A?ll Programmab:le 器件的硬;件▷。倘若打算包蕴经管器(”Z。ynq 、SoC。 或“MPU 软“核?)○▲,设备后的器件随即可供嵌入:式软件工程!师编程▪。

  为了“帮帮嵌入式软件工程师应对繁杂的编程“劳动◇,赛灵■“思供给了!基于E;clipse ?的集◇:成打算●;处境…•,即赛灵思软件开垦套件(SDK)○○,其包蕴编纂器■▷、编译器●▽、调试器=、驱动步骤和面向Zynq SoC 或FPGA 的○。库,其内嵌了赛灵思的32 位M!icroBlaze、T○•”M 软核。该SDK, 于10 多■□。年前推出,跟着赛灵思器;件上经管器集成的、兴盛蜕化而取得了大幅提拔,此前器件上集成硬化的DSPSlice 和软核MCU和MPU(8位、16 位和32 位),到Virt”ex-4 和Virtex-5 FPGA 时已改动为集成硬化的32 位PowerPC ;到Zynq SoC 已转化为集成32 位ARM经管器;而到即将推出的Zynq UltraScale+ MPSoC 则兴盛到集成64 位ARM 经管器。

  10 多年来▪,赛灵思与国度仪器(NI)和MathWork■○“s 公司不停仍旧密契合作▷。这两家公司极力于为其供职的特定用户供给量身定造的特别高级开垦处境□。

  美国国度仪器(NI)(德克萨斯州奥斯汀)供给的硬件平台深”受限造和测★”试编造立异者迎接。赛灵思的FPGA和Zynq SoC 为NI RIO 平台供给动力。NI 的LabVIEW开垦处境?是用户友情型图形化步骤◆☆,底层运转Vivado打算?套件,以是NI 的客户无需明晰任何FPGA□…; 打算细节。少少人!或者底•=!子不知晓RI、O 产物的!中枢本来是赛◇”灵思器件。他们只需正在LabVIEW 处境中对其编造编程即可,NI 硬件能提拔其开垦的打算职能。

  M!ath▲;Works(马萨诸塞州纳蒂克),该公司10 多年前为其MATLAB、Simul●◁”ink、HDL Coder和”Embedded Cod:er 增加了FPGA 支柱,底层运转赛灵思的ISE 和Vivado东西,并且齐备“自愿化。以是,公司的用户—=□:— 首要是数学算法开垦职员—、— 能!开垦算?法并。大幅提△”拔算法;职能,并且能、正在F△☆”PGA 布局上-;轻!易运转算!法。

  10 年•…,前•▪,赛灵思为其ISE 开垦处▽!境增加了FPGA 架构级东西—— 编造天生器(System Generator),近期▷▼?又给V“ivado 打算套件增加了■◇,以帮帮具备FPGA 学问的团队进一步骤整打算□,达成算法职能增益。MathWorks 和赛灵思两家公司时间的强强组合,有帮于客户公司推出成千上万种立异产、物▲。

  近期,其他公司也入手下手为赛灵思处境做出?奉献□☆。赛灵思近期迎来TOPIC Embedded Systems 和Silicon Software 这两家欧洲公司参加其同盟铺排,非常是迎接、其针对△○?医学和工业、商场的高级开垦☆?处境。

  TOPIC Embedded Systems(荷兰埃因霍温)具有特别的开垦处境DYPLO-,《赛灵思中国通信第54 期》对其实行了周详先容☆○。该处境面向Zynq S!oC,很疾也将面向△“Zynq MPSoC,对编造级打算采用同一技巧,从而使编,造架构师可以用C 或C++ 创筑编造打算结果,并正在Zynq SoC 的双核ARM Cortex-A9 经管编造上运转▼•“该结果。一朝用户觉察打算某些部门正在软件中运转太慢,能够,将这些○★?部门拖放!到窗口中★,将C 发言转化为FPGA 逻辑(底层运转Vivado HLS),并将其放入,Zynq SoC 的可=!编程逻辑中。来回互换代码片断,直达到到最佳!编造职能。TOPIC 最初用于医疗配置,开垦,目前也入手下手与工业配置筑设商合营。

  Silicon Software(德国曼海姆)是支柱软件工程师行使赛灵思All Programmable 器件的最新同盟成员。公司的VisualApplets 图形图像经管打算处境可帮帮面向Zynq SoC 平台的编造架构师和软件工程师打造工业呆板视觉使用立异-,并且无需-?硬件工程师的协帮◁。正在2013 年SPS “Drives 行业展会的赛灵思展台上,Silicon Softw□“are显示了-=!其用Vi”sualApplets 处境开垦的光学查验编造。演示显示通过采用VisualApplets ★“处境将图形经管工作从Zynq SoC 的经管编造转交给器件的FPGA 逻辑来奉行□…,能将编造…◇、职能提拔10 倍▲。

  借帮SDx 软件界说开垦处境,赛灵思将面向:合节商场的软件开垦职员和◇-:编造架构师修建一系列高级的◁、打算初学处境。SDAccel 和S“DSo▼;C 正在底层自愿?运:转全豹Vivado 流程,无需直接利用Vivado 东西,也无需硬件=◇,工程师的“协帮••。SDN:et 不□“会探访Viv“ado HLS,针对线;道卡架构○△。师,其供给了特别的“两步。利用模子”。

  正在第、一步中=,线道卡!架构师采用=☆“直观的、近似C 发言的高级发言而不是浸滞的微代码来打算需求,并同意“收集线!道卡规▽■:格形容▪○。SDNet 开垦处境,遵照规格形容天生R•;TL 版打算。流程随后必要硬件工程师正在倾向FPGA 中达成RTL•★。

  正在第二:步中,SDNet 还准许收集公司用高级发言测试和更新和说,并升级线道卡的成效,即使正在现场安顿后也能做到,并且无需硬件打算参预△。这个流程有帮于企业急速创筑并更新线道卡…=,这种灵敏性对软件界说收集而、言相○”当要紧。

  SDAcc。el 和SDSoc 这两个新打算处境将SDx 的理念扩大到新的使用规模。

  《数据中央学刊》(Data Center 。Journal)2014 年3 月的一篇作品指出,谷歌、Face•●,book、亚马逊、领英☆:等公•☆。司中枢部门——”数★”据库—★▲?—●“损耗的电!力●“占环球“电力3% 以上,同时发生2 亿公。吨二氧化●•。碳”。如许浩大的能耗?使得!其数据:中央一年电费赶上600 …=、亿美元。即使对最大领△-”域收集◁,公司来说-■,功耗”也会主○△,要减少赢○★。余性,并且对处境?也会发生不行揣测的影响▲•。

  跟着越来越多的企。业盼愿采?用云筹算和大数”据理会时间▼◆;视频和流媒体的环球性普。及▷,以及越来越多的人参加无线G收集,对数目更,多、职能更好的数据中央的需求呈几何级◆”无▷•。尽头、伸长趋向…。《数、据中央:学;刊》作◆●;品指出,从现?在趋向●?看★▲,到2017 年数据中央流、量估★•?计将达”7•.7ZB,这意味着数据中央的功耗倘若不行取得有用限造将会显示大幅伸长•。当今人人半数据中央的功耗首要源于其根底组件——Intelx86 经管器☆■。目前MPU 能供给优▪,异但不是最佳的职能,并且功耗很高。

  很多数据中央配置厂商已证明▪,分立式FPGA联络分立式CPU利用,固然每个卡的功耗会增长一点点▪-,但职能却▷▪“取”得“大幅提拔▼△,从而可大☆◁”幅提拔职能,功,耗比。再有人:以为,通过采用一颗正在单个SoC上集成x86经管器内核和FPGA逻辑的芯片,希望进一步提拔职能功耗比。再有:人以为,正在单个So◆☆“C▷•!上集成FPGA逻:辑和64位ARM经管器IP如同能带来更低功耗但同样高职能的治理计划☆■。

  正在数□?据中央?利用FPGA 的首要膺惩便是编程题目。数据中央开垦职员习俗于x86 架构编程,这些开垦职员平常惟:有纯软件编程靠山。帮帮开垦职员将CPU 步骤转向更疾的GPU 的第一步便是业界OpenCL 发言的怒放开垦。过去。2 年□!来,OpenCL 得到进一步兴盛,使客户可以针对FPGA 实行编程,从而为另日数据中央配置架构甚至无所不正在收集成立了新的机▲“会。

  通过推“出SDAccel 处境,赛灵思补充。了编、程边界▼=,并为数据中央。工程师利用★;O■▼:pen“CL○、C 或C++ 编,程☆■!FPGA 平台摊平了道道○■,并且:无需硬件•★、工程师介◆?入。赛灵思公司打算技巧商场高级总监Tom Feist 展现,针对OpenCL、C 和C++ 的SDAccel 开垦处境使数。据中央编程职员可以打造出比:CPU 和GPU 编造职能功耗比跨过25倍的配置。

  Feist▼、 指出,正在SDA◆;ccel 流程中,x86 CPU 联络运转赛灵思20nm Kintex UltraScale FPGA 的加快卡,软件开垦职、员能觉察必要加快的使用□…,并用OpenCL 编码和优化内核◁,再为、CPU编译和奉行使用。随后他们再来评估并调试内核,直到找到周期准确■★,的模子。接下来☆,再用S;DAccel ■。编译代码,并自愿达?成正在-、FP,GA 中,(能够!由于Vi;vad:o “正在底□,层运转)。随后就能□▽!运转!使用,验证通过“卡加、快后-?的使用职能以◆”及与□○。纯朴用CPU 运转的职能对▼”照。Feist 、指出:“他们○■”能轮回!运转迭代,直到▪;找到职能◇▪,和功耗!之间的=,最”佳均衡,相对◆“付CP-●:U 和◁。GPU“ 达成计“划,职能功△。耗比可、提拔多达•“25 倍△◇。”?

  SDNet ○□”让线卡开垦职员可以行使。特别的软界说形式急速创筑下一代收集●,而SDAccel 则能让数据中央配置厂商的下一代数据中央打算的达成最佳职能功耗比。新的。SDSoC 、开垦、处境或者能为赛灵思用户群带来最普遍的影=△!响•。这是由于SDSoC 针对普遍的嵌入式编造打算团队,非常是软?件工程师,这些软件工程▼=。师打算▷-;面向:的是赛灵思Zynq SoC 所供职的大“部门商场•。SDSoC 处境现正在能让用户设,备逻辑—— 不单是对运转Zynq SoC 硬件平台的嵌入式编造经管器编程——并且能利用C 和C++ 发言。

  利用SDSoC 处境,嵌入式软件•“开”垦职员能利用C“ 或C++发言创筑打算并实行测试,以觉察Zynq SoC 经管编造上哪些部门运转得不佳。一朝觉察可“疑代码,便越过显示并夂箢SDSoC 处境自愿将该代码分区到Zynq SoC 的可编程逻辑中,以加快编造◇、职能。Nick“ 指出,SDS…。oC”处境只需▲?点击按•”钮就,能把软件成效移,到FPG▽▲?A 逻:辑中★□,无需硬件工程师介、入★。SDSoC 中的编译器将天生全豹“Vivado 项目,并为倾向硬件平台天生可开导的软件”映像。

  《筹算▽▷“机编造布!局”—行业,篇1》之,编造▪▪;软件开垦、运维、测试、灰色资产、IT古:板开垦!

  点,击右方▲△?佳嵌:图标,能够:看全盘;课程。《筹算◁▪;机编造布局》。 ,之 行业篇◆”1首要涉及实,质位,筹算机科学、编造软件开。

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  跟、着面?向 A!ma?zon ◇◇?EC2 F1 ;实例的 ?SDA○△:cc◆”e“l 开垦!处境的,安顿,让不太、熟谙? FP•▼;GA•○: ☆...▪◁?

  作家▪▷:张宇清 可◆△”编“程■•?逻:辑器件(▼?PLD)□:的两种”首要类型是现场可编程门阵列(FPGA•;)和庞杂可编程逻辑器件(CPLD)□。遵照半导..?

  某些异、构 ?So★•“C 面向:多个器件级与编造级、安!闲成效供给支柱•,便于轻松!达。成。这些器件”可以?对启动和设备流程...◇◁!

  Zy,nq UltraSc”ale+ MPSoC的多媒体成效和搭配其的经管引擎•。

  针对•□, UHD-4K 集成了支柱 H○.264/H.265 ▼“的视频编解码器”单位●,实用。但不光仅实;用于监、控、.■▷..?

  此=;类 SD-FEC 成效平常正在高◇★!职能 FPGA 的可编程逻辑中达成。跟着为了支柱数千兆位速度而进一步..□.?

  末了▼◆,他们还扼。要先;容了近■◇“期公,布的 ▼▼!R?F 数据转;换器评估东西○●。该东西与 ZCU111 评估套件合伙运转.◇.☆▷.▪?

  你好, 我要通过TRM,我没有觉察许多合于固定成“效块的讲明。 过程“几个章节,我得出,结论▷▪,固定△!成效块是!一○…,组独;立的可编!程逻辑=..?

  S:DSo:C开垦处境可“供给高度简化、近似ASS?P C/C+?+的编程体验,征求轻易易用“的Ec;lip:se集.▷•.=□.!

  正在★!大学时-?期▪,我和少少!友,人正在高级项目中初度测验了嵌入式编造编程-。咱们创造了一个“物联网”(I;oT)闹!钟△.▲□..?

  许可软件开垦东西集的腾贵能够会导:致公司软件开;垦流程:中显示瓶颈。独立调试器将有帮于分拨劳动负载,以达成.▲.•▷.!

  专用集成“电道(ASIC)采用硬接线的固定形式,而现场可编程门阵列 (FPGA)则采用可设备芯片的技巧,二者差异迥▽!异。可编程器件..!

  现场可编程门阵列(FPGA)是一种可编程逻辑器件,最初简直仅用于高职能编造打算的原型创造。量产时,F.△..。

  AS、IC打算工程师”有◇”着不错:的职?业远景,只须他们不会正在必要进步身手,程度的工夫还“闻风不动”。就像一;个资深:工程师所讲明;的那样..…。

  入:选原故…★:开垦第一个中文操作编★▲、造CCD;OS★,参预创造四通,利方◁◇,掌控最大的中文网站新浪网时间总架构。 .▲.!

  各式使△”用的饱励,使F“PG。A兴盛•;到了一个合节点,它正正在逐渐庖、代其他时:间=,进入新的“商场规”模•,以是,咱们面”对的寻事是不竭立;异,▪..?

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  但▲▲。与之▽○。相对的•◇,40 ?岁以上、的开垦!者占○!比;简直能=“够怠忽不计。遵照差异年岁段的名望漫衍表也可见一斑,仍有部.▽=.=□.。

  入手▼、下手时:有庞杂的”逻辑合联,是咱们入门者刚才接触的数电▲◁?方面的根!底使用,打算一个根底的TTL逻辑,遵照真◆...?

  把一个!有专用主意•,并拥有肯!定领域的电道或子编造集成化而打算!正在。一芯片上,这便是专用 集成电道ASI:C的▪..☆.?

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  任正:非发□。出的这。封信的大,靠山也•◆:很额表•,2018 年中美生意战入手下!手,中兴、华为首当其冲成“为美国开刀的对★“象.○..◁■?

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